職位描述:1.參與FPGA芯片的Specification和Architecture的檢視，根據Specification和Arch進行測試點分解和用例設計；2.寫作模塊級或Top級驗證方案，開發Testbench,開發可重用驗證模塊，開發調試測試用例，負責覆蓋率的收集和分析；3.負責3rdIP的匹配性驗證和集成；4.負責模塊級或Top級驗證報告的寫作，參與驗證報告評審等；任職要求：1.計算機科學與技術、電子工程學、微電子學、碩士或以上學歷；5年以上芯片驗證、FPGA設計驗證相關工作經驗者優先；2.熟悉數字邏輯設計、驗證，包括前后仿；熟悉UVM驗證方法學，熟悉常用的測試點分解和測試用例設計方法；3.熟悉模擬和混合信號IC電路的驗證；4.熟悉掌握流片和測試流程，有流片和測試經驗者優先；5.熟練掌握Verilog或SV語言和仿真環境，了解低功耗設計和SOC基本知識；6.熟練掌握VCS、Verdi等工具，能進行問題定位和波形分析，能在Linux環境熟練開展工作（包括但不限于GVIM的使用）；7.具有很強的責任心、敬業精神和團隊合作精神，有創新意識和主動學習的能力；備注：2-6具備其中1項以上能力即可

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【急招，即推即安排】一、工作職責1.負責EDA工具的設計和開發（邏輯綜合、布局布線、時序計算、配置生成）；2.負責EDA工具的持續調優；3.基于EDA工具能力，對芯片架構進行優化；二、崗位要求1.計算機軟件、信息技術、電子工程、數學本科及以上學歷；2.3年以上C/C++軟件開發經驗，有EDA軟件經驗更佳；3.熟練掌握VisualStudio和Linux環境下C++編程；4.具有很強的責任心、敬業精神和團隊合作精神，有創新意識和主動學習的能力。

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崗位職責：1、為研發部門提供IT技術支持;2、管理Linux群集和編譯開發環境，滿足研發人員對計算與存儲的需求(熟悉Windows系統操作，熟悉Linux服務器)；3、負責數據中心機房服務器、、存儲系統、備份系統、監控系統等的管理和維護；4、撰寫和維護文檔與知識庫，培訓與指導Tier1支持部門，以增強IT支持效率5、與IT部門其他團隊員工協同合作，確保公司軟硬件系統穩定可靠運行；任職要求：1、全日制本科及以上學歷，5年以上相關工作經驗，有良好的溝通協調能力、熱情協作的積極態度；2、精通WindowsServer、linux等主流服務器系統，熟練掌握一門腳本語言，PowerShell,Perl,Shell，Python等；3、精通linux服務的配置，包括但不限于：NFS\SFTP\Docker等；4、熟悉Ansible,Zabbix,Jenkins等自動化運維工具，有任務調度系統管理經驗者優先；5、熟練掌握服務器虛擬化技術、虛擬桌面VDI、VMare、hyper-v等；6、具有版本管理工具經驗（git/svn/ClioSoftSOS）者優先；7、積極主動學習能力強、有責任心和紀律性、具備良好溝通能力及敬業、團隊精神；8、理解TCP/IP，具備CCNA或以上的業務素質。

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崗位職責：1、協助實施持續集成/持續交付（CI/CD）流程，支持開發團隊實現自動化構建、測試、版本發布和服務部署。2、維護并持續優化現有CI/CD流水線，確保其穩定性和高效性；協助開發團隊按需新建、升級流水線。3、編寫和維護自動化腳本（如Shell、Python、Groovy等），提升各階段的部署效率。4、協助配置和管理代碼倉庫（如Git），優化代碼構建體系（如CMake/Make）等。5、監控CI/CD流程運行狀態，協助定位并解決構建失敗、部署報錯、服務器異常等問題。6、配合開發團隊進行周期性或臨時性的版本發布工作。任職要求：1、計算機科學、軟件工程或相關專業本科學歷2、2-3年經驗。3、熟悉至少一種CI/CD工具（如Jenkins、GitLabCI、TravisCI、TeamCity等）。4、熟悉Git版本控制及分支管理策略，熟練掌握CMake者優先。5、掌握基礎腳本語言（如Shell、Python、Groovy），熟悉軟件打包發布流程（如RPM、DEB、InstallShield）者優先。6、了解Linux系統操作及基礎運維知識（如Crontab、SSH配置）。

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崗位職責：維護和完善數字電路綜合流程。完成數字電路的時序約束。提供timingsignoff的標準，并檢查STA結果。生成自用EDA軟件需要的timingmodel數據。協作工作，與團隊中的RTL設計工程師、數字后端工程師一起確保設計的準確性和成功交付。崗位要求：本科或以上學位，計算機工程、電子工程或相關領域。2年以上數字電路綜合（SynopsysDesignCompiler）和時序約束經驗。熟練處理數字電路的時序分析和約束開發。了解Verilog和SystemVerilogRTL設計語言和流程。了解數字電路后端流程，如ICC2、Innovus、PrimeTime等。了解物理設計和布局布線的基礎知識。了解DFT的基礎知識和設計要求。掌握腳本工具（如Tcl，Perl）的經驗。有FPGA，高速接口設計（例如DDR，PCIe，Ethernet，Serdes）優先。有良好的團隊合作和溝通能力，能夠與團隊中的其他工程師協作。具有解決問題和尋找創新解決方案的能力。具有良好的英語口語和寫作能力，能夠與海外同事合作

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崗位職責1、參與數字IP的規格定義；2、完成IP內模塊級的各類文檔編寫、RTL實現及相關驗證工作；3、完成IP內模塊級的PPA（Performance，Power，Area）優化；4、與驗證團隊合作，協同完成Block級，Top級驗證工作。崗位要求1、本科及以上學歷，具有三年以上的ASIC設計經驗，熟悉數字IC設計流程；2、熟練使用verilog編寫RTL，熟練使用EDA工具,能夠獨立解決技術問題；3、具有Verilog代碼PPA優化的經驗；4、熟悉Linux系統，掌握至少一種腳本語言(Python/shell/tcl/perl等)；5、有過復雜IP開發經驗者優先（PCIE/ETH/AMBA總線/ARM/RISC-V/DDR/MIPI/NOC/SERDES等）；6、有良好的團隊溝通能力和合作精神。

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本公司招聘多名吊籃安裝工大工，有證的能獨立在工地作業的人員，聽從安排，服從指揮，有責任心有上進心的工人工資基本上按計件兒安裝一臺多少錢的有質素有住宿

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8月1日 08:30

張先生

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